미니 잡담: LITTLETREE66이 추리한 오라이온 코어 구조도

Section31
조회 수 510
2024.05.04. 19:54

https://github.com/llvm/llvm-project/blob/8aebe46d7fdd15f02a9716718f53b03056ef0d19/llvm/lib/Target/AArch64/AArch64SchedOryon.td

https://tieba.baidu.com/photo/p?kw=%E9%AB%98%E9%80%9A&flux=1&tid=9004352871&pic_id=2d08212dd42a283485360f361db5c9ea14cebfc8&pn=1&fp=2&see_lz=1&post_id=150222887026

요약

1) L1 캐시 : 명령어 192 KB, 데이터 96 KB

2) L2 캐시 : 8 MB

3) ROB Entry : 376

4) 정수연산 스케줄러 : 120 Entry

5) 부동소수점연산 스케줄러 : 192 Entry

6) 디코더 wide 폭 : 14 (추정) -> 14-wide 디코더

그의 코멘트 : "누비아랑 타이샨(TSV)**이랑 무슨 협정이라도 맺었나요?"

** 하이실리콘이 독자 개발한, 기린 9000s 시리즈에 탑재된 CPU 코어

살펴보니, 디코더 폭은 넓은데 그에 걸맞지 않게 리오더 버퍼 수가 턱없이 적어서

이 때문에 IPC가 후달리는 게 아닌가 싶습니다.

[Mobile]
Galaxy Note9 512GB
- 이후 플랜: UNKNOWN

[Tablet]
Galaxy Tab S6 Lite
- 이후 플랜: iPad Air 6? 또는 mini 7?

[Laptop]
Dell XPS 13 9370 (이전) → (Galaxy Book3 (with ARC))
→ MacBook Air 15 M2 (2023년식)

		8
				
1등1q2w3e4r!
		2024.05.04. 20:04					
흥미롭게도 arm 레퍼런스는 L3캐시 용량에 힘을 줬는데 
애플/퀄컴 자체 아키텍쳐는 공통적으로 L2캐시 용량을 많이 가져가네요.
그리고 14-wide 디코더면 그 규모가...ㄷㄷ

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글쓴이Section31
						 1q2w3e4r! 님께
				
		2024.05.04. 20:08					
14-wide라고 추정한 까닭은, 깃허브의 해당 파일에서 "let IssueWidth = 14;"라고 나와 있기 때문입니다.

					 1
					
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ASTRAY
						 1q2w3e4r! 님께
				
		2024.05.04. 20:07					
L2 부분은 애플 실리콘 개발자들이 저쪽으로 많이 갔어서 그럴거에요

					 1
					
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글쓴이Section31
						 ASTRAY 님께
				
		2024.05.04. 20:09					
문제는 그에 걸맞지 않게 reorder 버퍼 사이즈가 376**밖에 안 되는데다,
레이턴시도 파이어스톰이 3사이클인데 이녀석은 4사이클입니다.
** 애플 파이어스톰 = 630

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2등오꾸리
		2024.05.04. 20:25					
저정도 entry로 14-wide 디코더를 굴릴수 있는건지...

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글쓴이Section31
						 오꾸리 님께
				
		2024.05.04. 22:20					
A14에 들어간 파이어스톰이 ~630 entry고 A15의 아발란체는 ~575 entry입니다. (둘 다 8-wide)
당연히, 14-wide 디코더인데 376 entry는 택도 없이 작은 규모라 생각하고 있습니다.
아마 저거 때문에 IPC가 후달리는 게 아닌가 싶기도 한데... (물론 수많은 요소 중 하나일 것 같기도 합니다)

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포인트봇
						 Section31 님께
				
		2024.05.04. 22:20					
회원님 4포인트 채굴 성공!

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3등gamma
		2024.05.04. 23:47					
저기서 알아서 잘 분석했겠지만 let IssueWidth = 14 이것만보면 decode width가 14라는게 아니라 백엔드에서 최대 14 issue까지 동시에 처리할 수 있다고 해석할 수도 있어보이네요.
참고로 파이어스톰이 11 issue 입니다.

					 2
					
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