미니 점점 헷갈리는 삼성 파운드리 노드들...그리고 TSMC 3나노 주저리..

흡혈귀왕
조회 수 962
2021.03.03. 16:53

14LPE, 14LPP, 14LPC, 14PU, 11LPP

10LPE, 10LPP, 10LPC, 8LPP, 7LPE, 8LPU

7LPP, 6LPP, 5LPE, 5LPP, 4LPE

4LPP

3GAE, 3GAP

등등의 족보인듯한데

어느순간 5LPA, 5LPI, 4LPI 같은 놈들이 중간에 등장하네요...ㅡㅡa;

흐음....특정 제조사용 커스텀 옵션일수도 있고 굉장히 MMO 해지는군요...

아참...TSMC 3나노 꽤 공격적으로 나오는듯하네요...

초기 5나노 공정 하프노드 어쩌고 하더니 풀노드 개선인듯합니다.

N3의 경우 프론트엔드는 여전히 FinFET이지만 N5 대비 밀도가 1.7배나 개선이더군요....

성능은 11%, 소비전력 27% 개선입니다.

성능은 몰라도

칩밀도랑 면적은 삼성 3GAE가 밀릴수도 있을거같습니다.

현재까지 알려진대로라면 삼성 3나노는 백엔드가 4LPP와 동일한 스펙에

프론트엔드쪽에 GAAFET 도입이니깐요...

그래도 백엔드보다 프론트엔드, 미들엔드 개선위주라서

7LPP에서 백엔드 위주로만 개선한 6LPP, 5LPE 같은 애들보단 성능 사정은 훨씬 나을듯합니다.

퀄콤빠, AMD빠, 테그라빠

		9
				
1등인헤리턴스
		2021.03.03. 17:01					
lpa lpi는 뭐죠 ㄷㄷlow power @@@일텐데
 
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글쓴이흡혈귀왕
						 인헤리턴스 님께
				
		2021.03.03. 17:05					
LPI(Low Power Improve)
리고합니다.
 
LPA는.......Low Power All
이려나요 ㅡㅡz

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인헤리턴스
						 흡혈귀왕 님께
				
		2021.03.03. 17:10					
어드밴스??

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2등전자개복치
		2021.03.03. 17:15					
LPI, LPA, LPU 등등 많긴 하네요 ㅋㅋㅋㅋㅋ
그나저나 tsmc는 핀펫 멱살끌고 어떻게든 3나노까지 가는 것으로 보이네요;; 물론 실제 밀도가 저렇게 뽑혀서 나올지는 지켜봐야 할 문제이긴 하지만...

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3등바보중
		2021.03.03. 17:26					
a14도 공정최대밀도보다 꽤 낮춰서 나왔던데 이젠 밀도마저 실적용과 따로노는건 아닐지;;

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글쓴이흡혈귀왕
						 바보중 님께
				
		2021.03.03. 17:30					
아 그러고보니 ISSCC 2021에서 N5 PPA가 N7 대비
향상값이 은근슬쩍 줄었네요..
 
원래라면
 
성능 15%
소비전력 25%
 
향상인데
 
위에 그래프대로라면
 
성능 13%
소비전력 21%
로 줄은 ㅡㅡㅋ

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나르자
		2021.03.03. 18:03					
아니 3나노에서도 TSMC가 유의미하게 유리한걸로 나온다면
삼성은 어찌해야합니까;
진짜 그러면 14나노때 딱한번 동률 처보고
10-7-5-3나노에서 모두 털리는거잖습니까;; ㅠㅠ
이러면 재미없어진다고요 ㅠㅠ

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글쓴이흡혈귀왕
						 나르자 님께
				
		2021.03.03. 18:07					
밀도랑 면적이 다가 아니니깐요...
어디까지나 면적이랑 밀도가 좀더 나을것으로 추정된다
정도니깐요...
 
참고로 7LPP도 밀도랑 면적만 놓고보면 N7/N7P 대비
더 작고 고밀도입니다. (면적 5~8% 작음)
 
삼성 3나노 특징은 프론트엔드에 GAAFET 도입을 통한
큰 성능 향상이니깐요...
 
성능을 봐야겠죠.
 
그리고 10나노 때 SPEC2006 기준
삼성 10LPE랑 TSMC N10은 성능 비슷했습니다.
면적이랑 밀도는 N10이 더 나았지만요...

					 1
					
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좌지우건
		2021.03.03. 21:41					
저 Area 부분은 '로직'
칩 area는 sram area 도 고려해야겠지요~
요즘 설계 트렌드가 sram 더 박는거니 더더욱~

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